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水平: Entry level
工作类型: Full-time
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工作内容
【工作內容】- Analog/mixed-mode signal IC design
- Power management IC design
- New analog IP developing
工作經歷:不拘
學歷要求:碩士以上
科系要求:電機電子工程相關、資訊工程相關
語文條件:英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
擅長工具:
- Spectre or Hspice
- Verilog-A, Verilog-HDL (nice to have)
- ADC: SAR, Delta-Sigma, Pipeline
- Switching power converter: Buck, Boost
- Voltage regulator: digital or analog LDO
- Special purpose analog/mixed-mode IC design
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最后期限: 20-12-2024
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