Position: Entry level

Job type: Full-time

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Job content

【工作內容】

Audio related product IC design

【教育程度】

碩士

【擅長工具】

verilog, nlint, design compiler

【管理責任】



【工作經驗】

1-3 年

【工作技能】

數位電路分析設計

RTL coding, logic simulation, timing analysis

【其他】

工作地點:竹北
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Deadline: 20-12-2024

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